簡易檢索 / 檢索結果

  • 檢索結果:共4筆資料 檢索策略: "Yi-Yu Liu".ecommittee (精準) and year="108"


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    1

    利用自動限制生成以考慮複雜佈局規則之網狀式堆疊導通孔設計
    • 電機工程系 /108/ 碩士
    • 研究生: 楊凱筌 指導教授: 方劭云
    • 在先進半導體製程中,佈局特徵的急劇縮小對電路延遲和電子遷移(EM)現象產生了重大影響。近來,網狀式堆導通孔(MSV)被提出作為改善電路時序和信號完整性的解決方案,每個MSV都是由平行金屬線和導通孔組…
    • 點閱:257下載:0
    • 全文公開日期 2025/07/14 (校內網路)
    • 全文公開日期 本全文未授權公開 (校外網路)
    • 全文公開日期 本全文未授權公開 (國家圖書館:臺灣博碩士論文系統)

    2

    針對片狀自組裝技術使用多圖案微影與自對齊導通孔製程之導引模板設計
    • 電機工程系 /108/ 碩士
    • 研究生: 石安傑 指導教授: 方劭云
    • 使用嵌段共聚物(block copolymers, BCP)的定向組裝技術 (Directed self-assembly, DSA)已經是一項具有發展性的光刻技術,可以在集成電路上生成微小的圖像。…
    • 點閱:335下載:0
    • 全文公開日期 2025/07/20 (校內網路)
    • 全文公開日期 本全文未授權公開 (校外網路)
    • 全文公開日期 本全文未授權公開 (國家圖書館:臺灣博碩士論文系統)

    3

    基於標準元件佈局置換引腳設計達到電路可繞線性最佳化
    • 電機工程系 /108/ 碩士
    • 研究生: 張家泓 指導教授: 方劭云
    • 標準元件之引腳可連接性(Pin Accessibility)在細節佈局流程(Detailed Placement)中扮演一個關鍵的角色,因此先前的研究提出了許多引腳可連接性的評估模型。然而在先進製程…
    • 點閱:212下載:0
    • 全文公開日期 2025/07/12 (校內網路)
    • 全文公開日期 本全文未授權公開 (校外網路)
    • 全文公開日期 本全文未授權公開 (國家圖書館:臺灣博碩士論文系統)

    4

    在標準元件布局中基於機器學習最佳化的機會
    • 電機工程系 /108/ 博士
    • 研究生: 禹道軍 指導教授: 方劭云
    • 隨著半導體製程持續的縮減,標準元件也變得更小。因此,設計規則的數量大幅增加,讓實體設計流程變得更困難,尤其是標準元件的繞線階段,很多設計規則違反可能會出現在此階段。由於複雜的設計規則和有限的繞線資源…
    • 點閱:206下載:0
    • 全文公開日期 2024/11/02 (校內網路)
    • 全文公開日期 2024/11/02 (校外網路)
    • 全文公開日期 2024/11/02 (國家圖書館:臺灣博碩士論文系統)
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